ケイデンス、TSMCとのパートナーシップを拡大し次世代AIシリコン設計を加速
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Cadence 宣佈擴大與台積電合作，針對 N3 至 A14 先進製程推出整合「代理型 AI」的設計流程，旨在加速次世代 AI 晶片開發與 3D-IC 異質整合。
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よくある質問
- Q: ケイデンスとTSMCのパートナーシップ拡大発表は2026年何月何日に米国時間で行われましたか？
- A: ケイデンスとTSMCのパートナーシップ拡大発表は2026年4月22日に米国時間で行われました。
- Q: ケイデンスがTSMCのN3プロセス技術で既に採用されているIPポートフォリオの名称は何ですか？
- A: ケイデンスがTSMCのN3プロセス技術で既に採用されているIPポートフォリオはCadence® Artisan®ファウンデーションIPです。
- Q: TSMCの3nmおよび2nmプロセス技術を用いた設計で、どのような市場インパクトが確認されていますか？
- A: TSMCの3nmおよび2nmプロセス技術を用いた設計では、多数の初期顧客と主流企業が設計を進めており、広範な市場インパクトが確認されています。
- Q: ケイデンスがTSMC N2P向けに提供するHBM4Eのデータレートは最大何Gbpsですか？
- A: ケイデンスがTSMC N2P向けに提供するHBM4Eのデータレートは最大16Gbpsです。
- Q: ケイデンスのChin-Chi Tengが述べた『Design for AI and AI for Design』戦略の基盤となる技術は何ですか？
- A: ケイデンスのChin-Chi Tengが述べた『Design for AI and AI for Design』戦略の基盤となる技術は“エージェント対応”の設計基盤です。